| Item type |
会議発表論文 / Conference Paper(1) |
| 公開日 |
2015-05-12 |
| タイトル |
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タイトル |
SOI-FPGA軌道実証評価装置(SOFIE)の詳細評価結果 |
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言語 |
jpn |
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言語 |
en |
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主題Scheme |
Other |
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主題 |
SOFIE |
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言語 |
en |
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主題Scheme |
Other |
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主題 |
In-orbit demonstration |
| キーワード |
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言語 |
en |
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主題Scheme |
Other |
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主題 |
SOI |
| キーワード |
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言語 |
en |
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主題Scheme |
Other |
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主題 |
FPGA |
| キーワード |
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言語 |
en |
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主題Scheme |
Other |
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主題 |
EEE Parts |
| キーワード |
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言語 |
en |
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主題Scheme |
Other |
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主題 |
ALOS-2 |
| 資源タイプ |
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資源タイプ識別子 |
http://purl.org/coar/resource_type/c_5794 |
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資源タイプ |
conference paper |
| アクセス権 |
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アクセス権 |
metadata only access |
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アクセス権URI |
http://purl.org/coar/access_right/c_14cb |
| その他のタイトル（英） |
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その他のタイトル |
Detailed evaluation and analysis of SOI-FPGA In-orbit demonstration Equipment(SOFIE) |
| 著者 |
土屋, 佑太
山田, 理子
水田, 栄一
坂本, 敬太
新藤, 浩之
鈴木, 浩一
Tsuchiya, Yuta
Yamada, Noriko
Mizuta, Eiichi
Sakamoto, Keita
Shindo, Hiroyuki
Suzuki, Koichi
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| 著者所属 |
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宇宙航空研究開発機構(JAXA) |
| 著者所属 |
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宇宙航空研究開発機構(JAXA) |
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宇宙航空研究開発機構(JAXA) |
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宇宙航空研究開発機構(JAXA) |
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宇宙航空研究開発機構(JAXA) |
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宇宙航空研究開発機構(JAXA) |
| 著者所属（英） |
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en |
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Japan Aerospace Exploration Agency(JAXA) |
| 著者所属（英） |
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en |
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Japan Aerospace Exploration Agency(JAXA) |
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en |
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Japan Aerospace Exploration Agency(JAXA) |
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Japan Aerospace Exploration Agency(JAXA) |
| 著者所属（英） |
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en |
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Japan Aerospace Exploration Agency(JAXA) |
| 著者所属（英） |
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en |
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Japan Aerospace Exploration Agency(JAXA) |
| 出版者 |
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出版者 |
日本航空宇宙学会(JSASS) |
| 出版者（英） |
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出版者 |
The Japan Society for Aeronautical and Space Sciences (JSASS) |
| 書誌情報 |
第58回宇宙科学技術連合講演会講演集
en : Proceedings of 58th Space Sciences and Technology Conference
発行日 2014-11
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| 会議概要（会議名, 開催地, 会期, 主催者等） |
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内容記述タイプ |
Other |
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内容記述 |
第58回宇宙科学技術連合講演会（2014年11月12日-15日. 長崎ブリックホール), 長崎市, 長崎県 |
| 抄録（英） |
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内容記述タイプ |
Other |
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内容記述 |
SOI-EPGA In-orbit demonstaration Equipment(SOFIE) on board ALOS-2 was launched on May 24, 2014. The purpose of the mission is to demonstrate an SOI-EPGA and JAXA qualified EEE parts so that we promote the use of them. The SOI-EPGA under development by CNES/Atmel and JAXA/HIREC is reconfigurable SRAM type and has 450k gates with SOI(Silicon on Insulator) technology. To confirm the behavior of the SOI-EPGA, we prepare an evaluation circuit including SEU(Single Event Upset) detection. At present, we performed the validation of all electrical parts. This paper reports the first detailed evalution of the SOI-FPGA, JAXA, qualified EEE parts: MPU(HR5000S), Burst SRAM, POL, and MEMS gyroscope(consumer product) as a source of SOI-FPGA date processing. |
| 資料番号 |
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内容記述タイプ |
Other |
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内容記述 |
資料番号: AC1500028000 |
| レポート番号 |
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内容記述タイプ |
Other |
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内容記述 |
レポート番号: JSASS-2014-4116 |
