| Item type |
会議発表論文 / Conference Paper(1) |
| 公開日 |
2015-03-26 |
| タイトル |
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タイトル |
State-of-the-Art Study on Mitigation Techniques of Single Event Effects in Terrestrial Applications |
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言語 |
en |
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言語 |
eng |
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言語 |
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主題Scheme |
Other |
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主題 |
terrestrial radiation |
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言語 |
en |
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主題Scheme |
Other |
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主題 |
fault |
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言語 |
en |
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主題Scheme |
Other |
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主題 |
soft-error |
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言語 |
en |
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主題Scheme |
Other |
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主題 |
failure |
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言語 |
en |
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主題Scheme |
Other |
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主題 |
network |
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言語 |
en |
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主題Scheme |
Other |
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主題 |
stack layer |
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言語 |
en |
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主題Scheme |
Other |
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主題 |
mitigation |
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言語 |
en |
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主題Scheme |
Other |
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主題 |
DOUB |
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言語 |
en |
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主題Scheme |
Other |
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主題 |
LABIR |
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言語 |
en |
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主題Scheme |
Other |
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主題 |
TMR |
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言語 |
en |
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主題Scheme |
Other |
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主題 |
MCBI |
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言語 |
en |
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主題Scheme |
Other |
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主題 |
bipolar action |
| 資源タイプ |
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資源タイプ識別子 |
http://purl.org/coar/resource_type/c_5794 |
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資源タイプ |
conference paper |
| 著者 |
Ibe, Eishi
Shimbo, Kenichi
Toba, Tadanobu
Taniguchi, Hitoshi
Uezono, Takumi
Nishii, Koji
Taniguchi, Yoshio
Ibe, Eishi
Shimbo, Kenichi
Toba, Tadanobu
Taniguchi, Hitoshi
Uezono, Takumi
Nishii, Koji
Taniguchi, Yoshio
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| 著者所属 |
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日立製作所横浜研究所 |
| 著者所属 |
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日立製作所横浜研究所 |
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日立製作所横浜研究所 |
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日立製作所横浜研究所 |
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日立製作所横浜研究所 |
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日立製作所通信ネットワーク事業部 |
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日立製作所 |
| 著者所属（英） |
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en |
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Yokohama Research Laboratory, Hitachi, Ltd. |
| 著者所属（英） |
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en |
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Yokohama Research Laboratory, Hitachi, Ltd. |
| 著者所属（英） |
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en |
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Yokohama Research Laboratory, Hitachi, Ltd. |
| 著者所属（英） |
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en |
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Yokohama Research Laboratory, Hitachi, Ltd. |
| 著者所属（英） |
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en |
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Yokohama Research Laboratory, Hitachi, Ltd. |
| 著者所属（英） |
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en |
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Telecommunication & Network System Division, Hitachi, Ltd. |
| 著者所属（英） |
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en |
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Corporate Quality Assurance Division, Hitachi, Ltd. |
| 出版者 |
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出版者 |
宇宙航空研究開発機構(JAXA) |
| 出版者（英） |
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出版者 |
Japan Aerospace Exploration Agency (JAXA) |
| 書誌情報 |
宇宙航空研究開発機構特別資料
en : JAXA Special Publication
巻 JAXA-SP-12-008E,
p. 148-154,
発行日 2013-03-29
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| 抄録（英） |
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内容記述タイプ |
Other |
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内容記述 |
Abstract-As semiconductor device scaling is on-going far below 100nm design rule, terrestrial neutron-induced soft-error typically in CMOS devices is predicted to be worsen furthermore. Moreover, novel failure modes that may be more serious than those in memory soft-error are recently being reported. Therefore, necessity of implementing mitigation techniques is rapidly growing at the design phase, together with development of advanced detection and quantification techniques. The most advanced such techniques are reviewed and discussed. |
| 内容記述 |
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内容記述タイプ |
Other |
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内容記述 |
形態: カラー図版あり |
| 内容記述（英） |
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内容記述タイプ |
Other |
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内容記述 |
Physical characteristics: Original contains color illustrations |
| ISSN |
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収録物識別子タイプ |
ISSN |
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収録物識別子 |
1349-113X |
| 書誌レコードID |
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収録物識別子タイプ |
NCID |
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収録物識別子 |
AA11984031 |
| 資料番号 |
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内容記述タイプ |
Other |
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内容記述 |
資料番号: AA0061889032 |
| レポート番号 |
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内容記述タイプ |
Other |
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内容記述 |
レポート番号: JAXA-SP-12-008E |
61889032.pdf (556.6 kB)
